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The advanced design flow for Nanometer analog applications

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每期人數限3到5人。注意：本課程一旦開課不予退費。

時間地點

上課地點：【上�！浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山學院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協同大廈
最近開課時間(周末班/連續班/晚班）：Nanometer培訓班：2020年3月16日

學時和費用

        ★課時：請咨詢在線客服


        ☆注重質量
        ☆邊講邊練
        ☆合格學員免費推薦工作

        ☆合格學員免費頒發相關工程師等資格證書，提升您的職業資質

        專注高端培訓15年，端海提供的證書得到本行業的廣泛認可，學員的能力
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質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后,授課老師留給學員聯系方式,保障培訓效果,免費提供課后技術支持。
        3、培訓合格學員可享受免費推薦就業機會。

課程大綱:

The advanced design flow for Nanometer analog applications

課程內容：

1． Cadence Virtuoso平臺介紹

2．? 定制數字和模擬集成電路的設計環境及數據需求介紹

3．? 基于上機操作的電路原理圖輸入

4．? 模擬設計環境的熟悉

5．? Spectre電路仿真器的基本使用方法和技巧

6．? 快速仿真器UltraSim的使用方法其性能體驗

7．? VSdE仿真環境的熟悉，練習設計規范的定義

8．? 在及時完成的一天內容的前提下，進入定制電路設計的后端內容

9．? 連接驅動的自動版圖生成技術

10．? 實時的DRC檢查能力

11．? Assura DRC/LVS物理驗證技術

12．? 定制數字和模擬電路的自動布線

13．? 寄生參數提取

14．? 寄生參數的反標和后版圖驗證流程

15．? Hierarchical Editor在后仿真驗證中的應用

16．? Stream Out

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