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  • 高速電路設計信號完整性和電源完整性分析培訓
       班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576( 微信同號)

            每期人數(shù)限3到5人。注意:本課程一旦開課不予退費

       質(zhì)量保障

            1、培訓過程中,如有部分內(nèi)容理解不透或消化不好,可免費在以后培訓班中重聽;
            2、培訓結(jié)束后,授課老師留給學員聯(lián)系方式,保障培訓效果,免費提供課后技術(shù)支持。
            3、培訓合格學員可享受免費推薦就業(yè)機會。

       教學時間,教學地點
                上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山學院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
                最近開課時間(周末班/連續(xù)班/晚班):高速電路設計信號完整性和電源完整性分析培訓開課:2020年3月16日
       實驗設備
      資深工程師授課

            
            ☆注重質(zhì)量
            ☆邊講邊練

            ☆合格學員免費推薦工作

            ☆合格學員免費頒發(fā)相關(guān)工程師等資格證書,提升您的職業(yè)資質(zhì)

            專注高端培訓15年,端海提供的證書得到本行業(yè)的廣泛認可,學員的能力
            得到大家的認同,受到用人單位的廣泛贊譽。

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       課程進度安排
    課程大綱

    本仿真課程以一個完整的DSP6000板子方案為主線,詳細講解仿真過程和原理,不僅詳細演示每步怎么做,而且詳解每步為什么這么做,讓學員徹底吃透。

     

    參加對象:

    從事高速數(shù)字信號設計的SI工程師、PI工程師、PCB設計工程師、EMC工程師,硬件設計工程師、測試工程師,項目經(jīng)理,技術(shù)支持工程師,研發(fā)工程師等。

    課程目標:

    本課程結(jié)合講師多年的理論和實戰(zhàn)工作經(jīng)驗,詳細介紹了信號完整性(SI)、電源完整性(PI),以及EMI/EMC設計較完整的知識體系,并介紹了工業(yè)界和學術(shù)界的最新成果,讓參與培訓的人員能夠了解問題的本質(zhì)。通過理論和實踐相結(jié)合的培訓方式,幫助電子行業(yè)工程技術(shù)人員在理解高速信號傳輸本質(zhì)和高速電源分配網(wǎng)絡的基礎(chǔ)上,掌握分析SI/PI問題的工具和技巧,提高在PCB,封裝和芯片產(chǎn)品設計的專業(yè)技能,最終能夠獨立的分析和解決SI/PI問題,為企業(yè)培養(yǎng)優(yōu)秀的SI/PI工程師和項目管理人員,提高產(chǎn)品性能質(zhì)量和可靠性,增強產(chǎn)品的市場競爭

    課程大綱:

    1.?高速系統(tǒng)設計技術(shù)及面臨的挑戰(zhàn)

    1.1?技術(shù)發(fā)展趨勢,工藝變化對設計提出的挑戰(zhàn);

    1.2?介紹最新的技術(shù),如3DIC,碳納米互連;電磁帶隙結(jié)構(gòu);

    1.3?用正確的思維設計高速電路;

    2.?電路的基本元件和參數(shù)

    2.1?認識電阻,電容,電感

    2.2?電路的幾個基本定理

    2.3?Z,Y,S參數(shù)的定義和基本性質(zhì)

    3.?傳輸線理論基礎(chǔ)及基本概念

    3.1?傳輸線的基本結(jié)構(gòu)和實際制造工藝;

    3.2?為什么是50?Ohm?

    3.3?傳輸線的建模方法;

    3.4?傳輸線方程的基本理論和參數(shù),如特性阻抗,傳輸常數(shù),;

    3.5?傳輸線結(jié)構(gòu)對參數(shù)的影響;

    3.6?高速信號是越快越好嗎?

    4.?高速傳輸線的反射

    4.1?反射的機理和影響;

    4.2?TDR?的原理和應用;

    4.3?反射的匹配技術(shù)和優(yōu)缺點;

    4.4?利用輸入阻抗分析問題;

    5.?高速傳輸線的串擾

    5.1?串擾產(chǎn)生的機理;

    5.2?串擾對時序的影響;

    5.3?串擾的抑制手段;

    6.?高速傳輸線-差分線

    6.1?差分線的優(yōu)缺點;

    6.2?差分信號和共模信號;

    6.3?無耦合差分線的阻抗匹配;

    6.4?耦合差分線的特性阻抗,傳輸速度,端接阻抗;

    6.5?差分信號和共模信號的端接;

    7.?抖動

    7.1?抖動的定義于分類;

    7.2?系統(tǒng)各元件對抖動的影響;

    7.3?抖動的PDF;

    7.4?抖動分離;

    7.5?抖動抑制;

    8.?高速串行和并行設計

    8.1?DDR的架構(gòu);

    8.2?HSS的架構(gòu);

    8.3?DDR?和HSS各自的優(yōu)缺點。

    9.?目標阻抗

    9.1?目標阻抗的定義;

    9.2?目標阻抗的趨勢和意義;

    10.?PDN網(wǎng)絡

    10.1?PDN基本組成元件;

    10.2?去耦電容的結(jié)構(gòu)和特性;

    10.3?去耦電容的選取,安裝與位置;

    10.4?電源/地平面的結(jié)構(gòu)和參數(shù)特性;

    10.5?芯片的供電軌道和IR?drop;

    10.6?Flip?chip?和Wirebond的結(jié)構(gòu);

    11.?SSN

    11.1?SSN的機理;

    11.2?SSN的抑制方法;

    11.3?SSN的周期特性;

    11.4?PDN設計的方法;

    11.5?噪聲與開關(guān)電流的特性;

    12.?系統(tǒng)級的PDN設計方法

    12.1?如何確定電壓,溫度,功耗?

    13.?PI和SI的協(xié)同設計

    14.?SI/PI?仿真軟件的介紹

    14.1?SI/PI的仿真分析方法

    14.2?Hspice

    14.3?HFSS


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