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模擬芯片版圖設(shè)計培訓(xùn)

賽靈思新的Vitis統(tǒng)一軟件開發(fā)平臺培訓(xùn)課程

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  • 筆記:(20)

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課程簡介

 

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教學(xué)優(yōu)勢

  曙海教育的課程培養(yǎng)了大批受企業(yè)歡迎的工程師。大批企業(yè)和曙海
建立了良好的合作關(guān)系。曙海教育的課程在業(yè)內(nèi)有著響亮的知名度。

  本課程,秉承20年積累的教學(xué)品質(zhì),以項目實現(xiàn)為導(dǎo)向,老師將會與您分享設(shè)計的全流程以及工具的綜合使用經(jīng)驗、技巧。

 

課程列表

  • 課程簡介:

  • 課程目標(biāo):

    課程大綱:

    賽靈思新的Vitis統(tǒng)一軟件開發(fā)平臺培訓(xùn)

    賽靈思新的Vitis統(tǒng)一軟件開發(fā)平臺培訓(xùn)

    課程安排

    第一階段 第一部分?介紹Vitis, Ultra96開發(fā)板和入手實驗

    1.?Vitis軟件平臺原理、軟件界面和開發(fā)流程介紹,包括各組件功能、軟件安裝、軟件和硬件仿真、相關(guān)工具VivadoPetalinux、HLS和SDK及它們之間的關(guān)系。

    2.?Ultra96開發(fā)板介紹,鏡像安裝和升級,硬件搭建和網(wǎng)絡(luò)配置。

    3.?用Vitis創(chuàng)建Hello WorldMemory、設(shè)備測試和FSBL鏡像啟動等項目并在開發(fā)板上運(yùn)行

    第一階段 第二部分?介紹HLS?C++硬件加速和IP封裝原理、HLS軟件,并通過GUI和Tcl?創(chuàng)建HLS若干實驗,熟悉了解HLS技術(shù)

    1.?Vivado?HLS硬件加速原理、開發(fā)流程、HLS軟件、加速方法pipeline和unroll。

    2.?使用Vivado HLS?GUI界面創(chuàng)建HLS?C++項目,C仿真驗證,高水平綜合,RTL驗證并打包成IP核。

    3.?學(xué)習(xí)Tcl命令,使用Tcl命令創(chuàng)建、驗證、綜合和打包HLS?C++項目,并比較不同優(yōu)化方法的Latency、Interval和資源利用率。

    4.?(選項)學(xué)習(xí)使用IP集成器設(shè)計調(diào)用和打包IP核,創(chuàng)建一個項目包含Tcl生成的兩個IP核,調(diào)用一個Xilinx FFT?IP核,打包并驗證設(shè)計。

    第二階段 第一部分?學(xué)習(xí)Xilinx定制嵌入式Linux軟件工具Petalinux軟件及重要概念

    1、Petalinux開發(fā)軟件、控制文件、開發(fā)命令和開發(fā)流程介紹,。

    2、構(gòu)建底層工具Make命令、Makefile、CMakeAutotools概念、程序和實驗。

    3、使用Petalinux生成最簡Ultra96?Linux系統(tǒng)。

    4、(選項)構(gòu)建PetaLinux軟件的Yocto架構(gòu)和BitBake工具學(xué)習(xí)和實驗。

    第二階段 第二部分?定制一個完整的Ultra96v2異構(gòu)加速平臺。

    實驗:設(shè)計制作Wifi和DPU功能的Ultra96v2 Vitis異構(gòu)加速平臺,以下內(nèi)容各約一個小時

    1.?使用vivado設(shè)計含Wifi和DPU功能的Ultra96v2硬件平臺。

    2.?使用Petalinux定制含Wifi和DPU功能的Ultra96v2?Linux軟件平臺。

    3.?使用Vitis設(shè)計含Wifi和DPU功能的Ultra96v2?異構(gòu)加速平臺。

    第三階段 ?學(xué)習(xí)使用Vitis軟件GUI和命令行開發(fā)基于RTL、C、C++OpenCL C的FPGA硬件加速項目,進(jìn)行評估、分析和優(yōu)化,部分實驗ultra96開發(fā)板上運(yùn)行

    實驗一、使用Vitis創(chuàng)建RTL向量加法器項目,并運(yùn)用Vitis Analyzer對時間線和DDR傳輸性能進(jìn)行分析。

    實驗二、?使用Vitis?C++/OpenCL分別使用界面方法和使用命令行創(chuàng)建向量加法器項目,由Vitis調(diào)用Vivado?HLS生成硬件kernel,運(yùn)行仿真,并在開發(fā)板上進(jìn)行測試。

    實驗三、使用HLS常用優(yōu)化方法對前面的實驗項目進(jìn)行優(yōu)化和仿真,用Vitis Analyzer獲得HLS報告,分析觀察優(yōu)化前后的加速器運(yùn)行狀態(tài)和性能

    實驗四、介紹Vitis?Opencv硬件加速庫和Streaming技術(shù),創(chuàng)建加速項目對圖像進(jìn)行縮放和高斯濾波等處理。

    實驗五、(選項)用Vitis設(shè)計數(shù)字濾波器有限長單位沖激響應(yīng)(FIR)濾波器,并進(jìn)行軟件和硬件仿真。

     



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